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兆易创新

主管FPGA工程师

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  • 15万-30万/年
  • 北京
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  • 3年以上
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  • 本科
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  • 全职

职位诱惑: 年终奖金,五险一金,福利好,老板nice,股票期权,技术领先,成长空间大,通讯津贴,交通补助,节日礼物,技能培训,购房贷款

发布时间: 2019-06-19发布

职位描述

工作职责
1、分析全新的系统平台设计任务, 并与FW制定实现方案。
2、FPGA芯片的选型,并协助完成电路原理图的设计。
3、完成设计文档的制定。
4、负责设计任务的Verilog实现、仿真和验证。
任职资格
1、通信、电子及相关专业本科及本科以上学历。
2、3年以上ALTERA或xilinx系列的FPGA设计经验。
3、熟悉FPGA的设计开发流程,熟悉Verilog语言,熟悉相关综合仿真软件。
4、有综合、仿真、验证工具流程的工作经验及硬件调试和故障排除经验。
5、有高速大规模FPGA使用经验者优先。
6、有eMMC、PCIe、SoC相关经验者优先。
7、工作踏实认真、易于沟通、有良好的团队合作精神。
薪资情况以实际面谈为准。

职位发布者

Cindy 刘鑫磊

HR

7天

简历处理用时

100%

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