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高级ASIC 设计工程师

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  • 上海
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职位诱惑: 成长空间大,技术领先

发布时间: 2018-05-04发布

职位描述

岗位职责:
1)    主要负责自研IP的高质量RTL设计,包括从IP架构到具体的Code实现;
2)    自研IP对于带宽、性能以及功耗等方面都有较高要求,需与算法设计团队密切合作,理解算法的大致流程。
 
任职要求:
1)    电子,微电子及计算机相关专业本科及以上学历,三年以上工作经历,或者相关研究方向的应届毕业生;
2)    熟悉linux工作环境,熟悉C/C++, Verilog/VHDL, SystemVerilog, SystemC, Tcl, Shell Script中多项语言;
3)    熟悉AMBA总线相关协议,或者有cache, memory缓存,DMA等相关经验;
4)    有FPGA设计使用经验,用FPGA设计过一些高性能计算模块(加分);
5)    有UVM/VMM/OVM等验证方法学使用经验(加分);
6)    有神经网络DNN计算单元在FPGA或者ASIC上的实现经验(加分);
7)    熟悉神经网络原理,了解相关的模型压缩,参数量化等机制(可选,加分);
8)    有较强的自学以及专研能力,有较好的团队合作以及追求卓越精神, 良好的文献检索及阅读能力, 愿意挑战及勇于试错的精神。

职位发布者

Claire Wu

HR

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